Simulateur de Portes Logiques

Simulateur de Portes Logiques

Le Simulateur de Portes Logiques est un bac à sable en ligne gratuit pour les circuits de logique numérique. Saisissez n'importe quelle expression booléenne utilisant des portes AND, OR, NOT, NAND, NOR, XOR et XNOR et le simulateur l'analyse immédiatement en un circuit au niveau des portes, trace le schéma sur un canvas, remplit la table de vérité complète pour jusqu'à 5 entrées, et vous permet de basculer chaque entrée d'un simple clic pour observer la propagation du signal en temps réel. Il est conçu pour les étudiants apprenant l'électronique numérique, les ingénieurs prototypant des circuits combinatoires et toute personne souhaitant tester une expression booléenne avant de la valider sur une platine d'essai, un schéma ou du code HDL.

Qu'est-ce qu'une porte logique ?

Une porte logique est la brique de base fondamentale d'un circuit numérique : un élément électronique qui reçoit une ou plusieurs entrées binaires (chacune valant 0 ou 1, souvent appelées BASSE et HAUTE) et produit une seule sortie binaire déterminée par une fonction booléenne fixe. Les portes logiques sont implémentées dans le silicium sous forme de réseaux de transistors — généralement CMOS — et constituent la réalisation physique de l'algèbre de Boole. Chaque ordinateur, smartphone et contrôleur numérique est finalement une composition à l'échelle du milliard de ces sept portes de base.

Les sept portes de base en un coup d'œil

Porte AND (ET)

La sortie est 1 uniquement lorsque toutes les entrées sont à 1 — considérez cela comme une connexion en série d'interrupteurs. Utilisée pour imposer plusieurs conditions, masquer des bits et implémenter la conjonction logique. Composant industriel : 7408 (quadruple AND à 2 entrées).

Porte OR (OU)

La sortie est 1 lorsqu'au moins une entrée est à 1 — considérez cela comme une connexion en parallèle d'interrupteurs. Utilisée pour les circuits d'alarme, le réglage de bits et la disjonction logique. Composant industriel : 7432.

Porte NOT (NON / inverseur)

Une porte à entrée unique qui inverse simplement 0 en 1 et 1 en 0. Utilisée pour nier des signaux, générer des lignes complémentaires et comme élément actif du CMOS. Composant industriel : 7404.

Porte NAND (NON-ET)

La négation de AND — produit 0 uniquement lorsque toutes les entrées sont à 1. NAND est une porte universelle : toute fonction booléenne peut être construite à l'aide de portes NAND seules, c'est pourquoi NAND domine le CMOS produit en masse. Composant industriel : 7400.

Porte NOR (NON-OU)

La négation de OR — produit 1 uniquement lorsque chaque entrée est à 0. Également une porte universelle. Célèbre pour être la porte centrale de l'Apollo Guidance Computer, construit entièrement à partir de portes NOR à 3 entrées. Composant industriel : 7402.

Porte XOR (OU exclusif)

Le OU exclusif affiche 1 lorsqu'un nombre impair d'entrées sont à 1. Crucial dans les additionneurs binaires (le bit de somme), les générateurs de parité, les comparateurs et la fonction de ronde de l'AES. Composant industriel : 7486.

Porte XNOR (NON-OU exclusif)

La négation de XOR — affiche 1 lorsque les entrées sont égales. Souvent appelée porte d'équivalence et utilisée comme comparateur d'un bit. Composant industriel : 74266.

Comment utiliser ce simulateur

1. Saisissez ou construisez votre expression dans la zone de saisie en haut. Vous pouvez taper directement ou appuyer sur les boutons du clavier pour les variables et les opérateurs. La syntaxe textuelle (AND, OR, NOT) et la syntaxe symbolique (&, |, !, ^) sont toutes deux acceptées.
2. Cliquez sur Simuler. Le simulateur analyse votre expression, vérifie la syntaxe, extrait les variables et calcule la sortie pour chaque combinaison (jusqu'à 32 lignes pour 5 entrées).
3. Basculez les commutateurs d'entrée au-dessus du schéma du circuit. Chaque commutateur est un bouton cliquable alternant entre 0 et 1 ; le circuit se met à jour en temps réel, mettant en évidence les fils actifs en rouge et allumant la LED de sortie verte lorsque Y = 1.
4. Consultez la table de vérité. Chaque combinaison d'entrée possible est répertoriée avec sa sortie ; la ligne correspondant à l'état actuel des commutateurs est mise en évidence.
5. Vérifiez les formes canoniques. Le simulateur affiche les équivalents Somme de Produits et Produit de Sommes — le point de départ pour la minimisation par table de Karnaugh ou la réduction de Quine-McCluskey.
6. Suivez l'évaluation. Le panneau étape par étape montre comment l'expression se réduit porte par porte pour un exemple d'entrée, ce qui est particulièrement utile pour déboguer des expressions imbriquées.

Syntaxe d'expression acceptée

• Variables : lettres uniques de A à Z (les minuscules sont automatiquement mises en majuscules). Jusqu'à 5 variables distinctes par expression.
• Constantes : 0, 1, ou TRUE/FALSE.
• Opérateurs textuels : AND, OR, NOT, NAND, NOR, XOR, XNOR (insensible à la casse).
• Opérateurs symboliques : & ou * pour AND, | ou + for OR, ! ou ~ pour NOT, ^ pour XOR.
• Groupement : les parenthèses ( ) peuvent être imbriquées librement.
• Priorité (de la plus haute à la plus basse) : NOT > AND/NAND > XOR/XNOR > OR/NOR. Utilisez des parenthèses en cas de doute.

Pourquoi ces préréglages valent la peine d'être explorés

Fonction de majorité (3 entrées)

(A AND B) OR (A AND C) OR (B AND C) — la sortie est 1 chaque fois qu'au moins deux des trois entrées sont à 1. C'est le cœur des circuits de vote à redondance modulaire triple (TMR) utilisés dans l'aérospatiale et l'informatique tolérante aux pannes.

Multiplexeur 2 vers 1

(A AND NOT S) OR (B AND S) — lorsque la ligne de sélection S est à 0, la sortie transmet A ; lorsque S est à 1, elle transmet B. Les multiplexeurs sont le tissu de routage des chemins de données et la table de correspondance (LUT) d'un FPGA est littéralement une cascade de multiplexeurs.

Parité 3 bits

A XOR B XOR C — affiche 1 lorsqu'un nombre impair d'entrées sont à 1. Les contrôleurs de parité sont utilisés dans la détection d'erreurs RAM, la communication UART et le stockage RAID.

Demi-additionneur

Le bit de somme d'un additionneur 1 bit est A XOR B ; le bit de retenue est A AND B. L'enchaînement de ceux-ci produit l'additionneur à retenue série au cœur arithmétique de chaque CPU.

Essentiels de l'algèbre de Boole

Identités fondamentales

• Identité : A + 0 = A ; A · 1 = A
• Nul : A + 1 = 1 ; A · 0 = 0
• Idempotence : A + A = A ; A · A = A
• Complément : A + ¬A = 1 ; A · ¬A = 0
• Double négation : ¬(¬A) = A
• Lois de De Morgan : ¬(A · B) = ¬A + ¬B ; ¬(A + B) = ¬A · ¬B
• Distributivité : A · (B + C) = (A · B) + (A · C)
• Absorption : A + (A · B) = A ; A · (A + B) = A

Somme de Produits (SOP)

Prenez chaque ligne où la sortie est 1, écrivez chacune comme un produit de variables (non complémentées pour 1, complémentées pour 0), et liez-les par un OU. Chaque fonction booléenne possède une SOP unique — le simulateur affiche la vôtre automatiquement.

Produit de Sommes (POS)

Le dual de la SOP : prenez chaque ligne où la sortie est 0, écrivez-la comme une somme avec des entrées à 1 complémentées et des entrées à 0 simples, puis liez tous les facteurs par un ET. Utile lorsque la fonction possède plus de 1 que de 0.

Applications concrètes des portes logiques

• Unités arithmétiques et logiques (ALU) : additionneurs, soustracteurs, comparateurs à l'intérieur de chaque CPU.
• Cellules de mémoire : les bascules SR, D, JK et T sont toutes des compositions de portes NAND ou NOR.
• Codeurs et décodeurs : traduisent entre les représentations "one-hot" et binaires dans les décodeurs d'adresses et les pilotes d'affichage.
• Logique de contrôle : machines à états finis, contrôleurs de feux de signalisation, distributeurs automatiques.
• Détection d'erreurs : contrôleurs de parité, moteurs CRC, encodeurs de code de Hamming.
• Cryptographie : XOR est l'opération de base dans les chiffres de flux et les fonctions de ronde des chiffres par blocs.
• FPGA : les tables de correspondance (LUT) implémentent des réseaux de portes arbitraires en stockant directement une table de vérité.

Conseils pour lire le schéma du circuit

• Les entrées sont des terminaux circulaires sur la gauche, étiquetés avec le nom de la variable et la valeur actuelle.
• Les portes utilisent les symboles standard ANSI/IEEE : forme en D pour AND, bouclier incurvé pour OR, triangle plus bulle pour NOT, etc. La petite bulle à la sortie marque les variantes inversées (NAND, NOR, XNOR).
• Les fils ont un code couleur : rouge (avec une lueur subtile) lorsqu'ils transportent un 1, bleu lorsqu'ils transportent un 0.
• La sortie apparaît sur le bord droit sous la forme d'un cercle vert plein lorsque Y = 1, et gris foncé lorsque Y = 0.

Foire aux questions

Quels opérateurs puis-je utiliser dans l'expression booléenne ?

Le simulateur accepte à la fois les opérateurs textuels (AND, OR, NOT, NAND, NOR, XOR, XNOR) et les opérateurs symboliques. Utilisez & ou * pour AND, | ou + pour OR, ! ou ~ pour NOT, et ^ pour XOR. Les variables sont des lettres uniques de A à Z (insensible à la casse), et 0 et 1 sont acceptés comme constantes. Les parenthèses peuvent être imbriquées librement pour contrôler l'ordre d'évaluation.

Quelle est la différence entre les portes NAND et NOR ?

NAND (NON-ET) affiche 1 chaque fois que le ET de ses entrées est 0 — c'est-à-dire dans tous les cas sauf quand toutes les entrées sont à 1. NOR (NON-OU) affiche 1 uniquement lorsque chaque entrée est à 0. Toutes deux sont appelées portes universelles car toute fonction booléenne peut être construite en utilisant uniquement des portes NAND, ou uniquement des portes NOR, c'est pourquoi elles sont les briques de base des circuits intégrés CMOS.

Pourquoi XOR produit-il 1 pour un nombre impair d'entrées à 1 ?

XOR (OU exclusif) affiche 1 lorsque ses deux entrées diffèrent. Des XOR en chaîne agissent comme un contrôleur de parité : la sortie est 1 lorsque le nombre total d'entrées à 1 est impair, et 0 lorsqu'il est pair. C'est pourquoi les portes XOR sont utilisées dans les générateurs de parité, les circuits de détection d'erreurs et dans la sortie de somme des additionneurs binaires.

Combien de variables le simulateur peut-il gérer ?

Le simulateur prend en charge jusqu'à 5 variables distinctes, ce qui donne un maximum de 32 lignes dans la table de vérité. Cette limite permet de garder la table de vérité complète lisible et le schéma du circuit compréhensible. Si vous collez une expression avec plus de 5 variables, l'outil vous demandera de la réduire.

Qu'est-ce que la forme Somme de Produits ?

La Somme de Produits (SOP) est une forme booléenne canonique où l'expression est écrite comme un OU de termes ET. Chaque terme ET correspond à une ligne de la table de vérité dont la sortie est 1. La SOP est le moyen direct de traduire une table de vérité en une expression booléenne et constitue le point de départ de la minimisation par table de Karnaugh et de la réduction de Quine-McCluskey.

Puis-je utiliser l'outil pour concevoir du matériel réel ?

Oui — le simulateur est utile pour l'apprentissage de la logique numérique, les devoirs, le prototypage sur platine d'essai avec des circuits intégrés de la série 74 et l'exploration de conception précoce pour des projets FPGA ou ASIC. Le schéma du circuit montre le nombre de portes et la structure, ce qui vous aide à estimer le nombre de puces ou l'utilisation des tables de correspondance avant de passer à un éditeur de schémas.

Lectures complémentaires

• Porte logique — Wikipédia
• Algèbre de Boole — Wikipédia
• Table de Karnaugh — Wikipédia
• Lois de De Morgan — Wikipédia
• CMOS — Wikipédia

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